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當(dāng)前位置： 首頁(yè)出版圖書科學(xué)技術(shù)工業(yè)技術(shù)建筑科學(xué)建筑結(jié)構(gòu)嵌入式系統(tǒng)原理及應(yīng)用：基于Cortex-A8處理器內(nèi)核（微課版）

嵌入式系統(tǒng)原理及應(yīng)用：基于Cortex-A8處理器內(nèi)核（微課版）

嵌入式系統(tǒng)原理及應(yīng)用：基于Cortex-A8處理器內(nèi)核（微課版）

定　價(jià)：￥59.00

作　者： 王蕊，曹振麗，姜佩賀，盛任
出版社： 清華大學(xué)出版社
叢編項(xiàng)： 高等院校信息技術(shù)系列教材
標(biāo)　簽： 暫缺
ISBN： 9787302640257 出版時(shí)間： 2023-10-01 包裝： 平裝
開本： 16開 頁(yè)數(shù)： 286 字?jǐn)?shù)：  

內(nèi)容簡(jiǎn)介

　　本書首先從讀者身邊的嵌入式系統(tǒng)引入嵌入式系統(tǒng)的定義、應(yīng)用、特點(diǎn)，從處理器和操作系統(tǒng)兩個(gè)不同的角度回顧嵌入式系統(tǒng)的發(fā)展過(guò)程，并展望未來(lái)的發(fā)展趨勢(shì)。然后從嵌入式系統(tǒng)組成的基礎(chǔ)知識(shí)出發(fā)，介紹嵌入式系統(tǒng)從設(shè)計(jì)到開發(fā)中可能面臨的問(wèn)題和方法，列舉了開發(fā)環(huán)境和開發(fā)工具。接下來(lái)，詳細(xì)介紹ARM系列的微處理器技術(shù)，并以基于ARM Cortex-A8內(nèi)核的S5PV210處理器芯片為載體介紹嵌入式系統(tǒng)的硬件接口和編程方法，包括GPIO接口、異常和中斷、脈寬調(diào)制定時(shí)器、看門狗定時(shí)器、實(shí)時(shí)時(shí)鐘、內(nèi)存控制器、ADC和觸摸屏復(fù)用接口的原理及應(yīng)用編程，以及存儲(chǔ)系統(tǒng)管理、啟動(dòng)過(guò)程和重定位的原理及相關(guān)程序。本書選取當(dāng)前針對(duì)ARM處理器常用的集成開發(fā)工具RVDS介紹編程實(shí)例本書結(jié)構(gòu)合理、內(nèi)容翔實(shí)，原理講解和芯片手冊(cè)結(jié)合，希望能夠引導(dǎo)學(xué)生掌握嵌入式系統(tǒng)的相關(guān)理論知識(shí)，同時(shí)培養(yǎng)學(xué)生具有查閱芯片說(shuō)明和手冊(cè)的能力。本書中的知識(shí)點(diǎn)結(jié)合編程實(shí)例，并在每章后留有練習(xí)題本書可作為高等院校計(jì)算機(jī)、物聯(lián)網(wǎng)、電子信息、集成電路及電氣自動(dòng)化等專業(yè)本科生“嵌入式系統(tǒng)原理及應(yīng)用”“嵌入式系統(tǒng)體系結(jié)構(gòu)”“嵌入式系統(tǒng)設(shè)計(jì)與開發(fā)”等課程的教材或參考書，也可作為嵌入式系統(tǒng)硬件接口原理應(yīng)用和開發(fā)人員的工具書。

作者簡(jiǎn)介

暫缺《嵌入式系統(tǒng)原理及應(yīng)用：基于Cortex-A8處理器內(nèi)核（微課版）》作者簡(jiǎn)介

圖書目錄

部分
第1章 嵌入式系統(tǒng)概述
1.1 嵌入式系統(tǒng)定義
1.2 嵌入式系統(tǒng)應(yīng)用
1.3 嵌入式系統(tǒng)特點(diǎn)
1.4 嵌入式系統(tǒng)發(fā)展
1.4.1 嵌入式處理器發(fā)展
1.4.2 嵌入式操作系統(tǒng)發(fā)展
1.4.3 嵌入式系統(tǒng)未來(lái)發(fā)展趨勢(shì)
1.5 本章小結(jié)
1.6 練習(xí)
第2章 嵌入式系統(tǒng)設(shè)計(jì)與開發(fā)
2.1 嵌入式系統(tǒng)組成
2.1.1 嵌入式系統(tǒng)硬件層
2.1.2 嵌入式系統(tǒng)中間層
2.1.3 軟件層
2.2 嵌入式系統(tǒng)設(shè)計(jì)與開發(fā)
2.2.1 嵌入式系統(tǒng)設(shè)計(jì)流程
2.2.2 平臺(tái)選擇
2.3 嵌入式系統(tǒng)開發(fā)過(guò)程
2.4 嵌入式系統(tǒng)開發(fā)環(huán)境和開發(fā)工具
2.5 追蹤和調(diào)試
2.6 嵌入式系統(tǒng)設(shè)計(jì)與開發(fā)中的其他問(wèn)題
2.7 本章小結(jié)
2.8 練習(xí)
第二部分
第3章 ARM處理器技術(shù)
3.1 處理器體系結(jié)構(gòu)
3.1.1 體系結(jié)構(gòu)概述
3.1.2 流水線技術(shù)
3.1.3 尋址和存儲(chǔ)器設(shè)計(jì)
3.1.4 RISC和CISC的區(qū)別
3.2 ARM處理器體系結(jié)構(gòu)
3.2.1 ARM簡(jiǎn)介
3.2.2 ARM體系結(jié)構(gòu)版本
3.2.3 ARM體系結(jié)構(gòu)下處理器系列
3.3 ARM Cortex-A8內(nèi)核
3.3.1 Cortex-A8概述
3.3.2 Cortex-A8處理器模式和狀態(tài)
3.3.3 Cortex-A8寄存器組織
3.3.4 Cortex-A8存儲(chǔ)器數(shù)據(jù)類型
3.3.5 Cortex-A8存儲(chǔ)器格式
3.3.6 Cortex-A8存儲(chǔ)器系統(tǒng)
3.3.7 Cortex-A8協(xié)處理器
3.4 ARM Cortex-A8異常處理
3.4.1 異常處理方式
3.4.2 Cortex-A8異常處理
3.4.3 Cortex-A8異常種類
3.5 三星S5PV210處理器
3.5.1 S5PV210整體結(jié)構(gòu)

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