Verilog程序設(shè)計(jì)與EDA（第二版）

　　本書(shū)除緒論外共分9章，主要內(nèi)容包括：Verilog HDL的基本結(jié)構(gòu)與描述方式、Verilo HDL的基本要素、Verilog HDL的基本語(yǔ)句、組合電路設(shè)計(jì)、時(shí)序電路設(shè)計(jì)、仿真測(cè)試程序設(shè)計(jì)、組合電路設(shè)計(jì)實(shí)例、時(shí)序電路設(shè)計(jì)實(shí)例、EDA開(kāi)發(fā)軟件等。書(shū)中選用了相當(dāng)數(shù)量的例題、實(shí)例，便于讀者聯(lián)系實(shí)際，舉一反三，學(xué)習(xí)運(yùn)用。 本書(shū)可作為高等學(xué)校通信、電子工程、自動(dòng)控制、工業(yè)自動(dòng)化、檢測(cè)技術(shù)及電子技術(shù)應(yīng)用等相關(guān)電類(lèi)專(zhuān)業(yè)本科和專(zhuān)科生Verilog HDL、EDA課程的教材和教學(xué)參考書(shū)，也可作為相關(guān)工程技術(shù)人員的學(xué)習(xí)參考書(shū)。

暫缺《Verilog程序設(shè)計(jì)與EDA（第二版）》作者簡(jiǎn)介