現(xiàn)代數(shù)字集成電路設(shè)計(jì)

第1章 集成電路設(shè)計(jì)概述1
第2章 vlsi系統(tǒng)設(shè)計(jì)策略5
2.1設(shè)計(jì)策略6
2.1.1層次設(shè)計(jì)7
2.1.2自動(dòng)設(shè)計(jì)8
2.2設(shè)計(jì)表示10
2.2.1功能表示10
2.2.2結(jié)構(gòu)表示11
2.2.3幾何表示14
第3章 器件設(shè)計(jì)技術(shù)17
3.1p-n結(jié)與半導(dǎo)體器件17
3.2mos晶體管及其特性19
3.2.1mos器件的設(shè)計(jì)方程23
3.2.2mos管的ui特性25
3.3雙極晶體管及其特性26
3.3.1工作特性27
3.3.2雙極晶體管特性28
3.4cmos晶體管31
第4章 一般邏輯電路設(shè)計(jì)38
4.1偽nmos邏輯38
4.2傳輸管邏輯40
4.3cmos邏輯門42
第5章 動(dòng)態(tài)邏輯電路設(shè)計(jì)50
5.1基本動(dòng)態(tài)cmos邏輯50
5.2cmos多米諾邏輯53
第6章 時(shí)鐘策略和i/o電路55
6.1單相時(shí)鐘55
6.1.1外部時(shí)鐘55
6.1.2內(nèi)部時(shí)鐘55
6.2雙相時(shí)鐘57
6.2.1產(chǎn)生方法58
6.2.2設(shè)計(jì)方法59
6.3四相時(shí)鐘62
6.4自定時(shí)系統(tǒng)63
6.4.1電路的延遲63
6.4.2自定時(shí)時(shí)鐘65
6.5i/o電路72
第7章 子系統(tǒng)設(shè)計(jì)76
7.1加法器76
7.2比較器86
7.3二進(jìn)制計(jì)數(shù)器86
7.3.1異步計(jì)數(shù)器87
7.3.2同步計(jì)數(shù)器87
7.4乘法器89
7.5隨機(jī)存儲(chǔ)器94
7.6譯碼器100
7.7讀/寫電路104
7.8數(shù)據(jù)通道107
7.9可編程邏輯陣列108
第8章 系統(tǒng)結(jié)構(gòu)化設(shè)計(jì)與實(shí)現(xiàn)方法115
8.1結(jié)構(gòu)化設(shè)計(jì)方法116
8.2門陣列設(shè)計(jì)118
8.3標(biāo)準(zhǔn)單元設(shè)計(jì)121
8.4自動(dòng)綜合122
8.5設(shè)計(jì)工具125
8.6集成電路測(cè)試127
第9章 數(shù)字系統(tǒng)設(shè)計(jì)自動(dòng)化134
9.1vhdl語(yǔ)言程序的基本結(jié)構(gòu)134
9.2vhdl構(gòu)造體的描述方式136
9.3vhdl中的對(duì)象和數(shù)據(jù)類型139
9.4vhdl語(yǔ)言的主要描述語(yǔ)句142
9.4.1描述信號(hào)變化的語(yǔ)句142
9.4.2描述結(jié)構(gòu)的語(yǔ)句151
9.4.3描述行為和描述結(jié)構(gòu)語(yǔ)句的混合描述154
9.5vhdl的設(shè)計(jì)共享155
9.6基本邏輯電路設(shè)計(jì)160
9.6.1組合邏輯電路設(shè)計(jì)160
9.6.2時(shí)序電路設(shè)計(jì)167
9.7vhdl仿真174
9.8vhdl語(yǔ)言的綜合176
參考文獻(xiàn)178