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內(nèi)容簡介

　　本書是根據(jù)1998年7月在北京召開的鐵路高校關(guān)于“面向21世紀電工電子列系課程教學改革”會議的精神編寫的。本書共分7章，內(nèi)容包括：數(shù)制與邏輯代數(shù)的運算規(guī)則及簡化方法；各種基本門電路；常用的組合邏輯電路；一般類型的觸發(fā)器的邏輯功能；常用的時序邏輯電路的分析方法；常用脈沖波形的產(chǎn)生與整形方法；存儲器和可編程邏輯器件及數(shù)字量與模擬量的變換等。本書在編寫過程中，力求突出以下幾點：考慮到當前電子技術(shù)的飛速發(fā)展和日新月異的趨勢，適當?shù)丶訌娏诵录夹g(shù)的內(nèi)容，以中規(guī)模集成電路為主；從教學方法上考慮，我們力求公安廳出基本概念和基本原理；由于教學學時的限制，盡量用物理概念來闡明問題的實質(zhì)，避免大量的公式推導(dǎo)；就全書而言，由淺入深、通俗易懂、便于自學，爭取以少量的學時達到適當?shù)纳疃群蛷V度。本書可作為非電類有關(guān)專業(yè)“電子技術(shù)基礎(chǔ)”課數(shù)字電路部分的教材，亦可作為在“電路基礎(chǔ)”和“應(yīng)用電子技術(shù)基礎(chǔ)”課之后的后續(xù)課教材，并可作為學習計算機硬件的輔助教材和選修教材。

作者簡介

暫缺《數(shù)字電子技術(shù)基礎(chǔ)》作者簡介

圖書目錄

1 數(shù)字邏輯基礎(chǔ)
1.1 數(shù)制和BCD編碼
1.2 邏輯代數(shù)
1.3 邏輯函數(shù)的表示法
1.4 邏輯函數(shù)的化簡
本章小結(jié)
習題
2 邏輯門電路
2.1 概述
2.2 TTL集成邏輯門
2.3 MOS集成邏輯門
2.4 各種集成邏輯門的性能比較
本章小結(jié)
習題
3 組合邏輯電路
3.1 組合邏輯電路的特點和任務(wù)
3.2 組合邏輯電路的分析和設(shè)計
3.3 常用組合邏輯電路
本章小結(jié)
習題
4 觸發(fā)器和時序邏輯電路
4.1 觸發(fā)器
4.2 寄存器
4.3 計數(shù)器
本章小結(jié)
習題
5 脈沖波形的產(chǎn)生與整形
5.1 多諧振蕩器
5.2 555定時器的原理及應(yīng)用
本章小結(jié)
習題
6 存儲器和可編程邏輯器件
6.1 只讀存儲器（ROM）
6.2 可編程邏輯器件（PLD）概述
6.3 可編程邏輯陳列（PLA）
6.4 可編程陳列邏輯（PAL）
6.5 通用邏輯陳列（GAL）
本章小結(jié)
習題
7 數(shù)/模與模/數(shù)轉(zhuǎn)換器
7.1 數(shù)/模轉(zhuǎn)換器
7.2 模/數(shù)轉(zhuǎn)換器
7.3 采樣-保持電路
本章小結(jié)
習題
附錄
部分習題參考答案
參考文獻